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Diseño de arquitecturas para la mitigación de fallos hardware en procesadores multinúcleo = Microarchitectural approaches for hardware fault mitigation in multicore processors

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dc.contributor.advisorAragón Alcaraz, Juan Luis
dc.contributor.advisorGarcía Carrasco, José Manuel
dc.contributor.authorSánchez Pedreño, Daniel
dc.contributor.otherDepartamento de Ingeniería y Tecnología de Computadoreses
dc.date.accessioned2011-11-29T10:19:47Z
dc.date.available2011-11-29T10:19:47Z
dc.date.created2011-07-25
dc.date.issued2011-11-29
dc.identifier.urihttp://hdl.handle.net/20.500.12696/3653
dc.language.isospaes
dc.rightsinfo:eu-repo/semantics/closedAccesses
dc.titleDiseño de arquitecturas para la mitigación de fallos hardware en procesadores multinúcleo = Microarchitectural approaches for hardware fault mitigation in multicore processorses
dc.typeinfo:eu-repo/semantics/doctoralThesises
dspace.entity.typePublication
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